{"id":3798,"date":"2025-11-18T00:00:00","date_gmt":"2025-11-18T00:00:00","guid":{"rendered":"https:\/\/lp.szlogic.cn\/glossary\/serdes-interfaces-high-speed-data-transfer-and-signal-integrity\/"},"modified":"2026-06-22T05:00:01","modified_gmt":"2026-06-22T05:00:01","slug":"serdes-interfaces-high-speed-data-transfer-and-signal-integrity","status":"publish","type":"post","link":"https:\/\/resourceslp.szlogic.cn\/el\/glossary\/serdes-interfaces-high-speed-data-transfer-and-signal-integrity","title":{"rendered":"Comprensi\u00f3n de SERDES: c\u00f3mo funcionan las interfaces serializador\/deserializador"},"content":{"rendered":"<figure class=\"wp-block-image aligncenter size-large\"><img fetchpriority=\"high\" decoding=\"async\" width=\"1200\" height=\"712\" src=\"https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cb4a0eb5eb7f42c39e00ee5ff87aad50.webp\" alt=\"Understanding SERDES: How Serializer\/Deserializer Interfaces Work\" class=\"wp-image-3794\" srcset=\"https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cb4a0eb5eb7f42c39e00ee5ff87aad50.webp 1200w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cb4a0eb5eb7f42c39e00ee5ff87aad50-300x178.webp 300w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cb4a0eb5eb7f42c39e00ee5ff87aad50-1024x608.webp 1024w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cb4a0eb5eb7f42c39e00ee5ff87aad50-768x456.webp 768w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cb4a0eb5eb7f42c39e00ee5ff87aad50-18x12.webp 18w\" sizes=\"(max-width: 1200px) 100vw, 1200px\" \/><\/figure>\n\n\n\n<p class=\"wp-block-paragraph\">Los sistemas de comunicaci\u00f3n de alta velocidad\u2014desde conmutadores Ethernet hasta transceptores \u00f3pticos\u2014dependen de una tecnolog\u00eda interna que la mayor\u00eda de los ingenieros utilizan a diario, pero rara vez ven directamente: <strong>SERDES<\/strong>, abreviatura de <strong>Serializador\/Deserializador<\/strong>. A medida que las velocidades de datos escalan de 10 G a 800 G, el SERDES se ha convertido en un bloque fundamental que permite la transmisi\u00f3n fiable a trav\u00e9s de enlaces el\u00e9ctricos y \u00f3pticos de alta velocidad.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Este art\u00edculo ofrece una visi\u00f3n clara y t\u00e9cnicamente precisa de la arquitectura del SERDES, su funcionamiento y sus aplicaciones, bas\u00e1ndose en fuentes autorizadas como <a target=\"_blank\" rel=\"\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/knowledge-center\/ieee-802-3-ethernet-standard-explained\/\">normas IEEE 802.3<\/a> y en los principios modernos de dise\u00f1o de E\/S de alta velocidad.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >Conclusiones clave<\/h3>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p>La tecnolog\u00eda SERDES convierte datos en paralelo en un flujo de datos seriales de alta velocidad, permitiendo una transferencia eficiente de datos entre dispositivos.<\/p><\/li><li><p>El uso de SERDES reduce el n\u00famero de l\u00edneas necesarias para la comunicaci\u00f3n, simplificando el dise\u00f1o de la placa y reduciendo costos.<\/p><\/li><li><p>El SERDES mejora la integridad de la se\u00f1al mediante se\u00f1alizaci\u00f3n diferencial, minimizando el ruido y la interferencia electromagn\u00e9tica.<\/p><\/li><li><p>Esta tecnolog\u00eda soporta aplicaciones de alta velocidad en centros de datos, sistemas automotrices y computaci\u00f3n avanzada, satisfaciendo las demandas cada vez mayores de transmisi\u00f3n de datos a alta velocidad.<\/p><\/li><li><p>Comprender el SERDES le ayuda a dise\u00f1ar sistemas m\u00e1s fiables y eficientes, mejorando as\u00ed el rendimiento general en entornos de alta velocidad.<\/p><\/li>\n<\/ul>\n\n\n\n<h2 class=\"wp-block-heading\" >\u00bfQu\u00e9 es el SERDES?<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">A <strong>SERDES (Serializador\/Deserializador)<\/strong> es un circuito de interfaz de alta velocidad que convierte <strong>datos en paralelo en datos seriales<\/strong> para su transmisi\u00f3n y luego los reconstruye nuevamente en <strong>datos en paralelo<\/strong> en el lado receptor.<br\/>Su prop\u00f3sito principal es soportar <strong>comunicaciones de alto ancho de banda, minimizando al mismo tiempo el n\u00famero de terminales, el desfase (skew) y los problemas de integridad de la se\u00f1al.<\/strong>.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">En lugar de utilizar buses paralelos anchos\u2014que requieren docenas de pistas y generan grandes m\u00e1rgenes de desfase\u2014el SERDES transmite los datos a trav\u00e9s de <strong>una o pocas v\u00edas diferenciales de alta velocidad.<\/strong>. Esto reduce la complejidad de la placa y permite un rendimiento mucho mayor.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" >\u00bfPor qu\u00e9 es importante el SERDES en la transmisi\u00f3n de datos de alta velocidad?<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">Los sistemas modernos deben soportar un ancho de banda masivo con bajo consumo de energ\u00eda, baja latencia y alta integridad de se\u00f1al. SERDES resuelve limitaciones clave de las interfaces paralelas tradicionales:<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >Limitaciones de los buses paralelos<\/h3>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p>Requieren muchos pines de E\/S<\/p><\/li><li><p>Enrutamiento complejo en PCB<\/p><\/li><li><p>Desviaci\u00f3n severa del reloj a tasas multi-GHz<\/p><\/li><li><p>Mayor <a target=\"_blank\" rel=\"\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/glossary\/what-is-electromagnetic-interference\/\">EMI<\/a> \u03ba\u03b1\u03b9 <a target=\"_blank\" rel=\"\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/glossary\/crosstalk-definition-causes-types-effects\/\">la diafon\u00eda<\/a><\/p><\/li>\n<\/ul>\n\n\n\n<h3 class=\"wp-block-heading\" >Ventajas de SERDES<\/h3>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p>\u03a7\u03c1\u03ae\u03c3\u03b5\u03b9\u03c2 <strong>menos pares diferenciales<\/strong><\/p><\/li><li><p>Admite <strong>multi-gigabit<\/strong> transmisi\u00f3n<\/p><\/li><li><p>Permite mayor alcance en PCB, backplane y fibra<\/p><\/li><li><p>Integra ecualizaci\u00f3n avanzada y recuperaci\u00f3n de reloj y datos (CDR)<\/p><\/li><li><p>Reduce el consumo de energ\u00eda y el costo total del sistema<\/p><\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Por ello, SERDES se utiliza en casi todos los est\u00e1ndares de alta velocidad, incluido Ethernet, <a target=\"_blank\" rel=\"\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/glossary\/what-is-pcl-express-pcie\/\">ranuras PCIe<\/a>, CPRI\/eCPRI, JESD204C y m\u00f3dulos \u00f3pticos como <a target=\"_blank\" rel=\"\" href=\"https:\/\/www.l-p.com\/store-26192-10g-sfp.htm\"><strong>SFP+<\/strong><\/a><strong> \u03ba\u03b1\u03b9 <\/strong><a target=\"_blank\" rel=\"\" href=\"https:\/\/www.l-p.com\/store-26153-40g-qsfp.htm\"><strong>\u03a0\u03b1\u03c1\u03ac\u03b3\u03c9\u03b3\u03bf \u03a0\u03b1\u03c1\u03ac\u03b3\u03c9\u03b3\u03bf<\/strong><\/a>.<\/p>\n\n\n\n<figure class=\"wp-block-image aligncenter size-large\"><img decoding=\"async\" width=\"1200\" height=\"712\" src=\"https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/d852c13dec9d4530894c7416cbe7afdd.webp\" alt=\"What Is SERDES?\" class=\"wp-image-3795\" srcset=\"https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/d852c13dec9d4530894c7416cbe7afdd.webp 1200w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/d852c13dec9d4530894c7416cbe7afdd-300x178.webp 300w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/d852c13dec9d4530894c7416cbe7afdd-1024x608.webp 1024w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/d852c13dec9d4530894c7416cbe7afdd-768x456.webp 768w, https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/d852c13dec9d4530894c7416cbe7afdd-18x12.webp 18w\" sizes=\"(max-width: 1200px) 100vw, 1200px\" \/><\/figure>\n\n\n\n<h2 class=\"wp-block-heading\" >C\u00f3mo funciona un SERDES (visi\u00f3n general de la arquitectura)<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">Un enlace SERDES consta de un <strong>transmisor (TX)<\/strong> \u03ba\u03b1\u03b9 <strong>receptor (RX)<\/strong> con varios bloques funcionales esenciales.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >1 Trayectoria del transmisor<\/h3>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p><strong>Entrada paralela<\/strong> (por ejemplo, 8, 16, 32 bits)<\/p><\/li><li><p><strong>Serializador<\/strong><\/p><\/li><li><p><strong>Codificaci\u00f3n<\/strong> (codificaci\u00f3n 8b\/10b, 64b\/66b o modulaci\u00f3n PAM4)<\/p><\/li><li><p><strong>Preacentuaci\u00f3n \/ ecualizaci\u00f3n<\/strong><\/p><\/li><li><p>Alta velocidad <strong>salida serial<\/strong> sobre un par diferencial<\/p><\/li>\n<\/ul>\n\n\n\n<h3 class=\"wp-block-heading\" >2 Trayectoria del receptor<\/h3>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p><strong>Entrada serial de alta velocidad<\/strong><\/p><\/li><li><p><a target=\"_blank\" rel=\"\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/glossary\/clock-and-data-recovery-in-modern-communication-systems\/\"><strong>Recuperaci\u00f3n de reloj y datos (CDR)<\/strong><\/a><\/p><\/li><li><p><strong>Ecualizaci\u00f3n (filtros CTLE\/DFE\/FIR)<\/strong><\/p><\/li><li><p><strong>Deserializador<\/strong><\/p><\/li><li><p><strong>salida paralela<\/strong> hacia el circuito integrado anfitri\u00f3n<\/p><\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Conjuntamente, estos permiten la transmisi\u00f3n a <strong>10G, 25G, 50G y 112G PAM4<\/strong>, y superiores.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" >SERDES dentro de los transceptores \u00f3pticos QSFP+<\/h2>\n\n\n\n<figure class=\"wp-block-image aligncenter size-large\"><img decoding=\"async\" width=\"1200\" height=\"712\" src=\"https:\/\/resourceslp.szlogic.cn\/wp-content\/uploads\/2026\/05\/cd651e491893415f957e92cd79a64e69.webp\" alt=\"QSFP+ Optical Transceivers\" class=\"wp-image-3796\" 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href=\"https:\/\/resourceslp.szlogic.cn\/el\/knowledge-center\/what-is-ieee-802-3ba-standard\/\"> IEEE 802.3ba<\/a> Seg\u00fan el est\u00e1ndar, un m\u00f3dulo QSFP+ utiliza:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p><strong>4 v\u00edas el\u00e9ctricas SERDES de 10,3125 Gbps<\/strong><\/p><\/li><li><p>Definidas por el <a target=\"_blank\" rel=\"\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/knowledge-center\/xlppi-electrical-interface-in-40g-qsfp-plus-modules-explained\/\"><strong>XLPPI<\/strong><\/a><strong> (Interfaz f\u00edsica paralela extendida de cuatro v\u00edas para 40G)<\/strong><\/p><\/li><li><p>Mapeadas a <strong>4 v\u00edas \u00f3pticas<\/strong> para 40GBASE-SR4<\/p><\/li>\n<\/ul>\n\n\n\n<h3 class=\"wp-block-heading\" >Funciones de SERDES dentro del m\u00f3dulo<\/h3>\n\n\n\n<ul class=\"wp-block-list\">\n<li><p>Convierte las <strong>v\u00edas el\u00e9ctricas SERDES anfitrionas<\/strong> en modulaci\u00f3n \u00f3ptica<\/p><\/li><li><p>Gestiona la recuperaci\u00f3n de reloj y datos (CDR) para cada v\u00eda<\/p><\/li><li><p>Asegura la estabilidad del enlace frente a variaciones de temperatura y voltaje<\/p><\/li><li><p>Trabaja con \u00f3ptica paralela para conexiones de fibra de corto alcance<\/p><\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Debido a esto, el rendimiento de SERDES define la integridad de se\u00f1al, la tolerancia al jitter y la calidad general del enlace del m\u00f3dulo.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" >Aplicaciones comunes de SERDES<\/h2>\n\n\n\n<figure class=\"wp-block-table\">\n<table class=\"has-fixed-layout\">\n<colgroup><col style=\"width: 288px;\"\/><col style=\"min-width: 25px;\"\/><\/colgroup><tbody><tr><th colspan=\"1\" rowspan=\"1\" colwidth=\"288\"><p>Tipo de aplicaci\u00f3n<\/p><\/th><th colspan=\"1\" rowspan=\"1\"><p>Est\u00e1ndares basados en SERDES<\/p><\/th><\/tr><tr><td colspan=\"1\" rowspan=\"1\" colwidth=\"288\"><p><strong>Ethernet para centros de datos<\/strong><\/p><\/td><td colspan=\"1\" rowspan=\"1\"><p>Ethernet 10G\/25G\/40G\/100G\/400G<\/p><\/td><\/tr><tr><td colspan=\"1\" rowspan=\"1\" colwidth=\"288\"><p><a target=\"_blank\" rel=\"\" href=\"https:\/\/www.l-p.com\/store-25432-optics-transceivers-sfp-modules.htm\"><strong>M\u00f3dulos \u00f3pticos<\/strong><\/a><\/p><\/td><td colspan=\"1\" rowspan=\"1\"><p>SFP+, QSFP+, QSFP28 y QSFP-DD<\/p><\/td><\/tr><tr><td colspan=\"1\" rowspan=\"1\" colwidth=\"288\"><p><strong>Backplane y chip-a-chip<\/strong><\/p><\/td><td colspan=\"1\" rowspan=\"1\"><p>PCI Express, SAS\/SATA<\/p><\/td><\/tr><tr><td colspan=\"1\" rowspan=\"1\" colwidth=\"288\"><p><strong>Telecomunicaciones \/ inal\u00e1mbrico<\/strong><\/p><\/td><td colspan=\"1\" rowspan=\"1\"><p>CPRI, eCPRI, Unidades de Radio<\/p><\/td><\/tr><tr><td colspan=\"1\" rowspan=\"1\" colwidth=\"288\"><p><a target=\"_blank\" rel=\"\" href=\"https:\/\/www.l-p.com\/store-26454-dac-aoc-aec-cables.htm\"><strong>ADC\/DAC de alta velocidad<\/strong><\/a><\/p><\/td><td colspan=\"1\" rowspan=\"1\"><p>JESD204B \/ JESD204C<\/p><\/td><\/tr><\/tbody>\n<\/table>\n<\/figure>\n\n\n\n<p class=\"wp-block-paragraph\">Todo sistema que transfiere datos a velocidades multi-gigabit depende en alg\u00fan punto de su trayectoria de se\u00f1al de un SERDES.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" >\u03a3\u03cd\u03bd\u03bf\u03c8\u03b7<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">SERDES es una de las tecnolog\u00edas m\u00e1s cr\u00edticas en las redes modernas. Al permitir una transmisi\u00f3n serial eficiente a alta velocidad, act\u00faa como columna vertebral de los m\u00f3dulos \u00f3pticos Ethernet, las telas de conmutaci\u00f3n de centros de datos, los enlaces chip-a-chip y los sistemas de comunicaci\u00f3n de pr\u00f3xima generaci\u00f3n.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Productos como <a target=\"_blank\" rel=\"\" href=\"https:\/\/www.l-p.com\/products\/491483.htm\"><strong>el m\u00f3dulo QSFP+ LQ-SW40-SR4C de LINK-PP<\/strong><\/a> dependen de un dise\u00f1o avanzado de SERDES para ofrecer un rendimiento estable de 40 G con excelente interoperabilidad y confiabilidad a largo plazo.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" >Preguntas frecuentes<\/h2>\n\n\n\n<h3 class=\"wp-block-heading\" >\u2666 \u00bfQu\u00e9 significa SERDES?<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">SERDES significa Serializador\/Deserializador. Se utiliza para convertir datos paralelos en datos seriales para su transmisi\u00f3n y luego volverlos a convertir en datos paralelos en el receptor.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >\u2666 \u00bfCu\u00e1l es la principal ventaja de usar SERDES?<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">Reduce el n\u00famero de cables y patillas necesarios para la transferencia de datos a alta velocidad. Esto simplifica sus placas de circuito impreso y mejora la calidad de la se\u00f1al.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >\u2666 \u00bfQu\u00e9 tipos de codificaci\u00f3n utilizan las interfaces SERDES?<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">Con frecuencia se encuentran esquemas de codificaci\u00f3n como 8b\/10b, 64b\/66b y PAM4. Estos ayudan a mantener la integridad de los datos y a soportar la recuperaci\u00f3n de reloj.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >\u2666 \u00bfQu\u00e9 aplicaciones utilizan la tecnolog\u00eda SERDES?<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">Encuentra SERDES en centros de datos, <a target=\"_blank\" rel=\"\" href=\"https:\/\/www.l-p.com\/store-25432-optics-transceivers-sfp-modules.htm\">m\u00f3dulos \u00f3pticos<\/a>, enlaces entre chips y interfaces de alta velocidad como Ethernet y PCI Express.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >\u2666 \u00bfQu\u00e9 es la se\u00f1alizaci\u00f3n diferencial en SERDES?<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">La se\u00f1alizaci\u00f3n diferencial utiliza dos cables para cada se\u00f1al. Obtienes una mejor inmunidad al ruido y una menor interferencia electromagn\u00e9tica, lo que ayuda a mantener la fiabilidad de tus datos.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" >V\u00e9ase tambi\u00e9n<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\"><a target=\"_blank\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/glossary\/ddm-dom-in-optical-transceivers\/\">La importancia de la supervisi\u00f3n digital en los transceptores \u00f3pticos<\/a><\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><a target=\"_blank\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/knowledge-center\/single-fiber-vs-dual-fiber-transceivers\/\">Diferencias clave entre transceptores de fibra \u00fanica y de fibra dual<\/a><\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><a target=\"_blank\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/optical-transceiver-terminology-guide\/\">Terminolog\u00eda esencial para comprender los transceptores \u00f3pticos<\/a><\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><a target=\"_blank\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/knowledge-center\/optical-transceivers-vs-fiber-converters\/\">Comparaci\u00f3n entre transceptores \u00f3pticos y convertidores de medios de fibra<\/a><\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><a target=\"_blank\" href=\"https:\/\/resourceslp.szlogic.cn\/el\/knowledge-center\/how-optical-transceivers-transmit-data\/\">El proceso de transmisi\u00f3n de datos en los transceptores \u00f3pticos<\/a><\/p>","protected":false},"excerpt":{"rendered":"<p>Las interfaces SERDES convierten datos en paralelo a serie para su transmisi\u00f3n a alta velocidad y con fiabilidad, reduciendo el cableado y mejorando la integridad de la se\u00f1al en electr\u00f3nica.<\/p>","protected":false},"author":1,"featured_media":3797,"comment_status":"open","ping_status":"open","sticky":false,"template":"","format":"standard","meta":{"_acf_changed":false,"footnotes":""},"categories":[27],"tags":[14,18,19,26],"class_list":["post-3798","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-glossary","tag-10g-sfp-transceivers","tag-40g-qsfp-transceivers","tag-aoc-dac-cables","tag-optics-transceivers"],"blocksy_meta":[],"acf":[],"_links":{"self":[{"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/posts\/3798","targetHints":{"allow":["GET"]}}],"collection":[{"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/posts"}],"about":[{"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/types\/post"}],"author":[{"embeddable":true,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/users\/1"}],"replies":[{"embeddable":true,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/comments?post=3798"}],"version-history":[{"count":5,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/posts\/3798\/revisions"}],"predecessor-version":[{"id":10872,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/posts\/3798\/revisions\/10872"}],"wp:featuredmedia":[{"embeddable":true,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/media\/3797"}],"wp:attachment":[{"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/media?parent=3798"}],"wp:term":[{"taxonomy":"category","embeddable":true,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/categories?post=3798"},{"taxonomy":"post_tag","embeddable":true,"href":"https:\/\/resourceslp.szlogic.cn\/el\/wp-json\/wp\/v2\/tags?post=3798"}],"curies":[{"name":"wp","href":"https:\/\/api.w.org\/{rel}","templated":true}]}}